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チップレット設計（チップレットセッケイ）
Multi-Die CPU/GPU設計手法。AMD Infinity Fabric(CCD+IOD)・Intel Foveros 3D Stacking(Meteor Lake/Arrow Lake/Lunar Lake)・EMIB(Embedded Multi-die Interconnect Bridge)・TSMC CoWoS(Blackwell/H200)・UCIe 2.0 open standard、Ryzen 9 9950X(2 CCD+1 IOD)・EPYC 9004(12 CCD)が2026年代表実装。
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2026/4/25 更新
関連タグ
Infinity Fabric
Foveros
UCIe 2.0
CoWoS
概要
チップレット設計は、CPUやGPUを複数の小型ダイで構成し、インターコネクトで結合する手法です。
AMD の Infinity Fabric（CCD+IOD）、Intel の Foveros 3D Stacking（Meteor Lake/Arrow Lake/Lunar Lake）、
TSMC の CoWoS（Blackwell/H200）などが代表例です。2026年に登場した Ryzen 9 9950X（2 CCD+1 IOD）や
EPYC 9004（12 CCD）が実用化を示しています。UCIe 2.0 はオープン標準として、チップレット間の
通信を統一化し、設計コストと製造リスクを低減します。
主な特徴・仕組み
- 分割設計：CPU コア、メモリコントローラ、I/O ダイを別々に設計。
- インターコネクト：Infinity Fabric、Foveros、CoWoS などで高速データ転送。
- スケーラビリティ：必要に応じて CCD を増減し、性能と消費電力を調整。
- 製造効率：小型ダイは高い歩留まりを持ち、リスクを分散。
- アップグレード性：I/O ダイを差し替えるだけで新世代への移行が可能。
- 熱設計：各ダイを個別に冷却でき、熱影響を抑制。
- コスト最適化：高性能コアを限定的に配置し、全体コア数を増やす。
- 設計時間短縮：再利用可能なダイテンプレートを活用。
- 多様な製造パートナー：TSMC、Samsung、GlobalFoundries で同一設計を製造。
- オープン標準：UCIe 2.0 により、異なるベンダー間での相互運用性を保証。
スペック/製品比較表
| 製品 | コア数 | スレッド数 | 主クロック | L3 キャッシュ | メモリタイプ | メモリ帯域 | 主要インターコネクト |
|---|---|---|---|---|---|---|---|
| Ryzen 9 9950X | 16 | 32 | 5.7GHz | 32MB | DDR5-4800 | 384GB/s | Infinity Fabric |
| EPYC 9004 | 48 | 96 | 3.0GHz | 24MB | DDR5-6000 | 768GB/s | Infinity Fabric |
| Core Ultra 9 285K | 12 | 24 | 2.5GHz | 16MB | DDR5-5200 | 512GB/s | UCIe 2.0 |
| RTX 5090 | 10,240 | 10,240 | 2.0GHz | 24MB | GDDR7-6000 | 1,200GB/s | NVLink |
| Meteor Lake | 8 | 16 | 1.8GHz | 8MB | LPDDR5-6400 | 256GB/s | Foveros |
具体例・対応製品
- Ryzen 9 9950X：2 CCD＋1 IOD の構成で、デスクトップ向けに高クロックを実現。
- EPYC 9004：12 CCD を組み合わせ、サーバー向けに 48 コアを提供。
- Core Ultra 9 285K：UCIe 2.0 を採用し、モバイルとデスクトップの両方で利用。
- RTX 5090：GPU でもチップレット設計を採用し、10,240 スレッドでレイトレーシングを高速化。
- Meteor Lake：Intel の 10nm Foveros で、CPU と GPU を同一パッケージに統合。
- Arrow Lake：2026年に発表された 7nm Foveros で、低消費電力を実現。
- Blackwell：TSMC CoWoS で製造され、AI 推論向けに 32GB HBM3 を搭載。
- H200：TSMC の 7nm CoWoS で、データセンター向けに 64GB HBM3 を提供。
自作PCでの選び方・注意点
- パッケージサイズ：チップレット設計は通常 LGA 1700 以上。マザーボードのソケットを確認。
- 電源要件：高クロック時に 150W 以上を必要とする場合がある。
- 冷却設計：各ダイに対して個別のヒートシンクを設置できるケースを選択。
- BIOS 対応：UCIe 2.0 をサポートする BIOS が必要。
- メモリ互換性：DDR5-6000 など高速メモリを選択し、帯域を最大化。
- 拡張スロット：PCIe 5.0 x16 を備えたマザーボードで GPU との接続を確保。
- ファームウェア更新：インターコネクトの安定性を保つため、定期的にアップデート。
- 価格帯：チップレット設計は高性能分、価格が上昇。予算に合わせて選択。
- サポート体制：メーカーのサポートが充実しているか確認。
- 将来性：次世代の UCIe 3.0 へのアップグレードを見越した設計を選ぶと長期的に有利。
関連用語との違い
- **モノリシック設計